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當(dāng)前位置：維庫電子市場網(wǎng)>IC>192b 更新時間:2025-09-09 09:45:24

192b供應(yīng)商優(yōu)質(zhì)現(xiàn)貨

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192b中文資料

  • 使用FPGA和IP Core實現(xiàn)定制緩沖管理

    0mhz即可滿足數(shù)據(jù)接口的需求。pram采用32位zbt sram ，接口時鐘使用系統(tǒng)時鐘，每個pcell為64位，每個讀、寫周期需要6個時鐘周期完成。在實際系統(tǒng)中采用altera fpga，bm的設(shè)計可以滿足10g的tm線速工作的需求。 在40g核心網(wǎng)的tm系統(tǒng)中，片內(nèi)數(shù)據(jù)總線的位寬為256位，系統(tǒng)時鐘采用250mhz(在40ge的系統(tǒng)中可選用200mhz)。采用 ddr ii sdram，接口時鐘使用333mhz，則192位的bram可以滿足40g的tm需求。此時，bcell可為96b、192b、384b，在這里選用 192b。當(dāng)bcell選用192b時，讀取操作和寫入操作同樣均為6個時鐘周期。在滿足40g系統(tǒng)的需求下，讀取、寫入操作周期為9個時鐘周期。 pram采用48位qdr sram，接口時鐘使用150mhz，每個pcell為96位，在每個讀、寫時鐘周期內(nèi)，pram最多可被操作5次。在采用altera fpga的情況下，bram采用192位 ddr ii sdram，pram采用48位qdr sram，bm的設(shè)計可以滿足40g的tm線速工作的需求。 來源:零八我的愛

  • 使用FPGA和IP Core實現(xiàn)定制緩沖管理(圖)

    250mhz即可滿足數(shù)據(jù)接口的需求。pram采用32位zbt sram ，接口時鐘使用系統(tǒng)時鐘，每個pcell為64位，每個讀、寫周期需要6個時鐘周期完成。在實際系統(tǒng)中采用altera fpga，bm的設(shè)計可以滿足10g的tm線速工作的需求。 在40g核心網(wǎng)的tm系統(tǒng)中，片內(nèi)數(shù)據(jù)總線的位寬為256位，系統(tǒng)時鐘采用250mhz(在40ge的系統(tǒng)中可選用200mhz)。采用ddr ii sdram，接口時鐘使用333mhz，則192位的bram可以滿足40g的tm需求。此時，bcell可為96b、192b、384b，在這里選用192b。當(dāng)bcell選用192b時，讀取操作和寫入操作同樣均為6個時鐘周期。在滿足40g系統(tǒng)的需求下，讀取、寫入操作周期為9個時鐘周期。pram采用48位qdr sram，接口時鐘使用150mhz，每個pcell為96位，在每個讀、寫時鐘周期內(nèi)，pram最多可被操作5次。在采用altera fpga的情況下，bram采用192位 ddr ii sdram，pram采用48位qdr sram，bm的設(shè)計可以滿足40g的tm線速工作的需求。

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